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AMS 参数、学习与实验记录

这份记录由你逐课填写，默认全部待完成。文档齐全、别人运行成功或脚本PASS都不能自动代填个人掌握状态。总纲 · 答案 · 规格。

我的目标与前置

模拟经验：CT ΔΣ ADC环路滤波器设计。数字目标：先同步RTL/SPI，再配置/测量/校准，连接CT ΔΣ后级及交织转换器。AM06首选A，可自行改选B。

前置 自己解释/画图的证据 状态
DFF、enable、同步复位与NBA 待填 待完成
SPI一帧/单clk FSM 待填 待完成
unsigned/signed、floor/RNE与饱和 待填 待完成
RC、比较器与采样窗口 待填 待完成
握手、总线保持、CDC与复位恢复 待填 待完成

每次运行的参数卡（复制使用）

字段 我的记录
lesson/run_id、日期、源码版本 待填
状态：解析/数字/AMS行为/电路替换 待填
IC/Xcelium/Spectre精确版本，OS 待填
top/config/ADE state与个人运行目录 待填
code/measurement编码、单位、合法范围 待填
clk/CE、timeunit/timeprecision、初态/reset 待填
R/C/rout、VDD/VSS、tr/tf、VIH/VIL 待填
模型延迟、sample/valid窗口、身份和超时优先级 待填
PVT/负载、噪声模型/种子、未建模项 待填
tran时长、maxstep/reltol/绝对容差、保存/导出网格 待填
预先预测、独立oracle、阈值及其依据 待填
各阶段退出/完成、检查器统计、结果 待填
日志/波形位置与哈希（产物不入Git） 待填
首次失败、修正、恢复基线与剩余问题 待填

config/接口绑定表（每次替换重新填）

实例 期望view 实际网表view 端口域/参考供电 适配/插桥与参数 核对证据
controller/counter 待填 待填 待填 待填 待填
DAC/plant 待填 待填 待填 待填 待填
comparator/measurement 待填 待填 待填 待填 待填
RC/S&H/feedback 待填 待填 待填 待填 待填

AM01：绑定与混合波形

  • 画域图与DFF/enable电路；计算0/1/128/255。
  • 预测100/500 ns电压，再记录实际误差和τ。
  • 检查逐实例真实绑定；回卷、同步复位与模拟初态。
  • 错误view或位序能被独立检查发现。
  • 保存两套求解设置的收敛对照并独立解释波形。
量 预测 实际 误差/解释
t0、DAC终值 待填 待填 待填
Vc(t0+100 ns) 待填 待填 待填
Vc(t0+500 ns) 待填 待填 待填
255→0/复位 待填 待填 待填

AM02：桥、电平和负载

  • 填写VIH/VIL、rout、边沿、初态和X/Z定义。
  • 计算并测量上/下阈值时间，区分理想/有限边沿。
  • 对比短脉冲、负载、低供电固定/相对门限。
  • 找到真实IE/桥位置，能解释无事件的原因。
用例 参数 阈值时间/回读预测 实际/原因
理想阶跃 待填 待填 待填
有限tr/tf与rout变化 待填 待填 待填
100 ns脉冲 待填 待填 待填
VDD0.6 V、X/Z 待填 待填 待填

AM03：settling与测量身份

  • 写LOAD/sample/valid/consume边沿表。
  • 5/25/35/39拍实验，分别记录残差与floor码。
  • 计算教学角落55拍的来源，注明非PDK签核。
  • response latency变化不改变sample数据。
  • busy-start、旧id、超时边界和复位有明确结果。
等待拍数/角落 实际t0/sample Vsample/残差 Q/期望Q id/结果
5 待填 待填 待填 待填
25 待填 待填 待填 待填
35 待填 待填 待填 待填
39 待填 待填 待填 待填
55，τ143 ns 待填 待填 待填 待填

AM04：SAR

  • 手算677.4LSB十次trial/kept。
  • 检查actual Vdac/sample/valid与held input。
  • 等待扫描、边界、busy/reset/timeout和迟到应答。
  • 写明现有同步RTL的接口局限与超时优先级。
  • 单实例替换前后的共模、延迟、负载与结果对照。

复制台账字段：conversion_id / bit / trial / trial_time / sample_time / Vin_hold / Vdac / cmp_ge / valid_time / kept / error。

AM05：trim

  • 测量单位、RNE负数边界、累加位宽正确。
  • 扫码/端点/单调前提与目标可达性明确。
  • 每个候选先等稳定，每块恰16次、最终两块通过。
  • trial与committed分开，version/id一致。
  • 噪声、不可达、超时、取消与供电故障均有退出。
  • 恢复旧code或FAULT有模拟条件依据。

复制台账字段：trial_code / version / request_id / load_time / sample_times / 16_samples / sum / mean / decision / verify_count / committed_code / reason。

AM06：选择与联合验证

选择：待填（建议A）。实际调制器/滤波或DAC架构及规格：待填。

  • 域图、频率/相位、sample编号和真实sample_time。
  • 小模块基准与完整系统分别记录，编码/数值参考独立。
  • 暖机、均匀网格、FFT窗/归一化/频带/延迟完整。
  • 两类故障能定位到接口/数字/模拟/数值来源。
  • 单实例替换与数值收敛对照；未做项明确待运行。
项目 预测/基准 实际结果 可以支持的结论
DC/带标记样本台账 待填 待填 待填
单音/谱口径 待填 待填 待填
故障1/故障2 待填 待填 待填
求解/导出收敛 待填 待填 待填
电路替换 待填 待填 待填

里程碑和自评

阶段 我能独立解释什么 解析/数字/AMS/电路证据 未解决项 状态
M1 AM01–03 待填 待填 待填 待完成
M2 AM04–05 待填 待填 待填 待完成
M3 AM06与替换 待填 待填 待填 待完成

每个“通过”要注明是哪类验证。真实环境已知缺项见设置指南，不将它重复记成个人操作错误；工具补齐后再补实际实验。结课后写一页：能复用的模型、真正需要电路证据的指标、下一步CT ΔΣ或TI项目要补的规格。